Etusivu Tutki Apua
Kirjaudu sisään
bart
/
FPGC6
peilaus alkaen https://github.com/bartpleiter/FPGC6
1
0
Fork 0
Tiedostot Ongelmat 0 Wiki
Puu: da2bff2ea2
Haarat Tagit
FPGC6
/
Quartus
/
clock_pll_v_sim
bart e1bb01a621 Cleaned and renamed Quartus project. 1 vuosi sitten
..
clock_pll_v.vo a76905443f Ported Quartus to 5CEA5 FPGA. SDRAM does not seem to work. 2 vuotta sitten