This website works better with JavaScript
Почетна
Преглед
Помоћ
Пријавите се
bart
/
FPGC6
огледало од
https://github.com/bartpleiter/FPGC6
Прати
1
Волим
0
Креирај огранак
0
Датотеке
Дискусије
0
Вики
Дрво:
7cfd77a292
Гране
Ознаке
EP4CE15
cpu100mhz
fast-cpu-pipeline
main
Историја ревизија
Пронађи
Аутор
SHA1
Порука
Датум
bart
5af536210d
Fixed instability by adding clear cache instruction during SPI transfer. No idea why this fixed the issue, as the I/O address range is above the limit for cache to work.
пре 1 година