This website works better with JavaScript
Головна сторінка
Огляд
Довідка
Увійти
bart
/
FPGC6
дзеркало
https://github.com/bartpleiter/FPGC6
Слідкувати
1
Зірка
0
Відгалуження
0
Файли
Проблеми
0
Wiki
Дерево:
f88d0c38c1
Гілки
Теги
EP4CE15
cpu100mhz
fast-cpu-pipeline
main
Історія комітів
Пошук
Автор
SHA1
Опис
Дата
bart
5af536210d
Fixed instability by adding clear cache instruction during SPI transfer. No idea why this fixed the issue, as the I/O address range is above the limit for cache to work.
1 рік тому